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IDT70T653M
High-Speed 2.5V 512K x 36 Asynchronous Dual-Port Static RAM
Waveform of Read Cycles (4)
t RC
ADDR
Industrial and Commercial Temperature Ranges
t AA
(3)
CE
(5)
t ACE
t AOE
(3)
(3)
OE
t ABE (3)
BE n
R/ W
t LZ /t LZOB
(1)
t OH
DATA OUT
VALID DATA
(3)
t HZ
(2)
.
5679 drw 06
NOTES:
1. Timing depends on which signal is asserted last, OE , CE or BE n.
2. Timing depends on which signal is de-asserted first CE , OE or BE n.
3. Start of valid data depends on which timing becomes effective last t AOE , t ACE , t AA or t ABE .
4. SEM = V IH .
5. CE = L occurs when CE 0 = V IL and CE 1 = V IH . CE = H when CE 0 = V IH and/or CE 1 = V IL .
Timing of Power-Up Power-Down
CE
I CC
t PU
t PD
I SB
50%
50%
5679 drw 07
.
10
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